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Makefile文件写法：
CC=g++
CFLAGS= -c -g
LDFLAGS= -g
target = ex_3_1
all: $(target)
target_objects=ex_3_1.o nouse.o
ex_3_1 :$(target_objects)
$(CC) $(LDFLAGS) -o $@ $^
@echo $@ Build OK.
.SUFFIXES:.cpp .o .cpp.o :
$(CC) $(CFLAGS) -o $@ $<
clean:
@rm -rf $(target)
$(target_objects) 1、注释及续行 #开头。太长时，使用字符“\”换行，\后面只能有换行，不能其它任何字符。
2、标识
可以是自定义标识、命令运行后的返回值（命令必须放在’’，如OS=’uname -s’、命令行里的环境变量，如$(PATH)
3、目标对象和源对象
语法：“目标对象：源对像”
4、扩展名对象生成规则
“.SUFFIXES:.源扩展名 .目标扩展名”
